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| 1. 목적 디지털 논리 회로 실험의 5주차에서는 반가산기(Half-Adder), 전가산기(Full-Adder), 그리고 2의 보수 시스템을 다.. / 1. 목적 2. 이론 3. 실험결과 4. 검토사항 5. 설계과제(토의) 6. 참고자료 / 1. 목적 디지털 논리 회로 실험의 5주차에서는 반가산기(Half-Adder), 전가산기(Full-Adder), 그리고 2의 보수 시스템을 다루는 것을 목적으로 한다. 이 실험은 디지털 회… |
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| [고려대학교 보건환경융합과학부 방사선안전분석] Lab 13 Half-Life of Ba-137m / 1. 실험제목 2. 실험동료이름 3. 실험목적 4. 실험장비 5. 실험절차 6. 실험결과 및 분석 7. 결론 8. Post-lab 문제 9. 실험 raw data 10. 참고문헌 0. Pre-lab 문제 방사선의 반감기는 방사성 동위 원소가 일정한 시간 동안에 반으로 감소하는 특성을 나타낸다. 이는 방사성 물질의 안전성 평… |
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| 9주차 Diode Half,Full Wave Rectifier 결과보고서(ㅎ대 A＋족보) / 1.실험 목적 2.실험 장비 3.실험 내용 4.실험 결과 및 고찰 / 1.실험 목적 이번 실험의 목적은 다이오드 정류기의 기본 작동 원리를 이해하고, 반파 정류기와 전파 정류기의 성능을 비교 분석하는 것이다. 다이오드는 전류가 한 방향으로만 흐르도록 하는 특성을 가지므로, 이를 통해 교류(AC) 전압을 직류(DC) … |
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| [고려대학교 보건환경융합과학부 방사선안전분석] Lab 13 Half-Life of Ba-137m / 1. 실험제목 2. 실험동료이름 3. 실험목적 4. 실험장비 5. 실험절차 6. 실험결과 및 분석 7. 결론 8. Post-lab 문제 9. 실험 raw data 10. 참고문헌 0. Pre-lab 문제 방사선 안전 분석 실험에서 바륨-137m(Ba-137m)의 반감기를 측정하는 것은 방사선의 기본 개념과 방사선의 세기 감소의 원리를… |
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| 9주차 Diode Half,Full Wave Rectifier 예비보고서(ㅎ대 A＋족보) / 1. 실험 목적 2. 기초 이론 1) Diode와 Resistor로 구성되는 Half-Wave Rectifier(반파정류기) 동작원리 2) Diode, Resistor, Capacitor로 구성되는 Peak Rectifier 동작원리 3. 참고 문헌 / 1. 실험 목적 Diode Half, Full Wave Rectifier에 대한 실험의 목적은 반도체 소자인 다이오드를 이용하여 교류 전압을… |
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| [A＋, 에리카] 2021-1학기 논리설계및실험 Half Adder, Full Adder 실험결과보고서 / 1. 실험 목적 2. 관련 이론 3. 실험 결과 / 1. 실험 목적 이번 실험의 목적은 디지털 회로의 기본적인 구성 요소인 Half Adder와 Full Adder의 동작 원리를 이해하고 실제 회로 구성 및 실험을 통해 그 작동을 확인하는 데 있다. 디지털 전자 시스템에서 덧셈 연산은 중요한 역할을 하기 때문에,… |
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| 한양대 Half adder , Full adder / 1. Chapter 1. 실험 목적 2. Chapter 2. 관련 이론 3. Chapter 3. 실험 결과 / 1. Chapter 1. 실험 목적 실험의 목적은 디지털 회로 설계의 기본적인 구성 요소인 반가산기(Half Adder)와 전가산기(Full Adder)의 동작 원리를 이해하고, 이들을 실제로 구현하여 반도체 소자의 동작을 학습하는 것이다. 반가산기는 두 개의 이진 신호를 입력으로 … |
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| Verilog HDL을 이용한 로직게이트설계 및 FPGA를 통한 검증 예비레포트 half, full, 4-bit adder / 1. 실험 제목 2. 실험 목적 3. 실험 장비 4. 관련 이론 5. simulation 6. 참고 문헌 / 1. 실험 제목 실험 제목은 `Verilog HDL을 이용한 반가산기, 완전가산기 및 4비트 가산기의 설계와 FPGA를 통한 검증`이다. 이 실험은 디지털 회로 설계의 기본이 되는 가산기의 동작을 이해… |
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| ‥ 실험 제목 실험 제목은 `Vivado를 이용한 Half Adder, Full Adder, 4 Bit Adder의 구현`이다. 디지털 회로에서 가장 기본적인 연산 중 하나는 덧셈이며, 이를 수행하는 회로인 가산기(adder)의 설계는 디지털 시스템의 핵심 요소로 자리 잡고 있다. 본 실험에서는 Xilinx Vivado Design Suite라는 FPG 디자인 툴을 이용하여 기본적인 가산기를 구현해 볼 것이다. 가산기는 크게 Half … |
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![[고려대학교 보건환경융합과학부 방사선안전분석] Lab 13 Half-Life of Ba-137m](/View/[고려대학교 보건환경융합과학부 방사선안전분석] Lab 13 Half-Life of Ba-137m (2) _hwp_01_.gif)
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![[A＋, 에리카] 2021-1학기 논리설계및실험 Half Adder, Full Adder 실험결과보고서](/View/[A＋, 에리카] 2021-1학기 논리설계및실험 Half Adder, Full Adder 실험결과보고서_hwp_01_.gif)
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